视频监控系统中多画面处理器的设计

视频监控系统中多画面处理器的设计

摘要：以黑白四画面处理为例，介绍了视频监控系统中基于FPGA器件和单片机的多画面处理器的设计方法，简述了FPGA器件XCS05XL的特点和工作原理，讨论了单片机μPD78F0034与I2C总线存储器X24C16的接口方法以及用μPD6453叠加字符的基本方法，同时概述了使用帧存储器AL422应注意的几个问题。

近年来，随着视频监控系统在各个领域的广泛应用，作为视频监近系统组成之一的多画面处理器的应用也愈来愈普遍。如使用一台九画面处理器，则可在一台监视器上同时监控9个目标，只需使用一台录像机便可对9路视频信号同时实时录像。目前多画面处理器有黑白/彩色四、九、十六画面处理器等6种类型。一般说来，多画面处理器除了有画面分割功能外，还须有视频信号切换及报警功能。视频信号功换功能是指多画面处理器有一路视频输出是输入视频信号或画面分割信号的顺序切换，且切换时间可调；报警功能是指多画面处理器能输入、输出报警信号，报警时相应的画面上叠加有报警信息，并将报警信息存储起来以便日后查阅。设计多画面处理器可使用专用DSP芯片，这样虽然满足了速度要求，但开发周期较长，产品的调试、修改及升级比较困难，成本较高。由于FPGA（即现场可编程门阵列）器件具有集成度高、体积小、功耗低、设计灵活且价格较低，有快速高效的开发平台，可加快开发周期等优势，因此目前多画面处理器的设计基本上采用FPGA作为其中的视频信号处理器件。由于FPGA的功能由其内部的编程数据确定，编程数据的装载方法之一是上电后由单片机实现，因此多画面处理器含有单片机。一方面利用单片机在上电后将FPGA所需的编程数据写入FPGA中，另一方面视频信号的切换、字符叠加及报警信息的处理也由单片机来完成。下面具体介绍基于FPGA器件和单片机的黑白四画面处理器的设计方法。

1 黑白四画面处理器的组成及主要功能

1.1 黑白四画面处理器的组成

黑白四画面处理器的方框图如图1所示。由图1可知，该多画面处理器以FPGA器件和单片机为核心，外加A/D、D/A、帧存储器、串行存储器、串行时钟和字符叠加等辅助芯片组成。

1.2黑白四画面处理器的主要功能

该四画面处理器主要功能如下：

·视频格式为CCIR模式，即视频信号的场频为50Hz；

·双工操作（在录像的同时可进行回放），菜单设定；

·全屏显示时象素为1024×512,256个灰度等级；

·4路CVBS输入及1路录像输入；

·1路全画面与四分割切换输出，1路录像输出（固定四分割）；

·切换时间可调，范围为1～255s。

·画面上可叠加时间日期，且位置可调整；

·有报警输入输出功能，报警复位时间的可调范围为1～300s；

·有视频信号丢失报警功能，报警时对应的画面上有文字显示。

2 各部分电路的结构及工作原理

2.1 输入缓冲及A/D转换

该部分电路的主要功能是将输入的模拟视频信号转换成数字视频信号供FPGA器件处理，其方框图如图2所示。4路视频信号经过受FPGA控制的模拟多路选择器后，输出2路视频信号，经过缓冲放大后送到受FPGA控制的模拟开关；然后再输出给A/D，2路视频信号需要2片A/D芯片。A/D芯片选TLC5510，该芯片是一种分辨率为8位、20MSPS（20兆采样点/秒）的CMOS模/数转换器。在FPGA的控制下，TLC5510将输入的模拟视频信号转换成数字视频误，然后送往帧存储器。

2.2 帧存储器

帧存储器选AVERLOGIC公司的AL422，共需要2片。AL422是存储量为384KB×8Bits的FIFO（First In First Out）DRAM，它支持VGA、CCIR、NTSC、PAL和HDTV分辨率，具有独立的读/写操作及输出使能控制；存储时间为15ns的高速异步串行存取，可在5V或3.3V电源电压下工作，标准的28脚SOP封装。

2.3 FPGA器件

FPGA是本设计的核心，与传统逻辑电路和门阵列相比具有不同的结构。FPGA利用小型查找表（16×1RAM）来实现组合逻辑，每个查找表连接到一个D触发器的输入端，D触发器再来驱动其它逻辑或驱I/O。这些模块利用金属连线互相连接或连接到I/O模块。FPGA通过向内部静态存储单元加载编程数据来实现其FPGA通过向内部静态存储单元加载编程数据来实现其逻辑，存储在存储单元中值决定了FPGA实现的功能；FPGA的这种结构允许无限次的重新编程。由此可见，用FPGA设计的产品调试修改及升级均很容易，且具有很大的灵活性。目前FPGA的种类很多，在本设计中选用Spartan系列的XCS05XL。该芯片是Xilinx公司推出的低价格、高性能的FPGA，其主要特点如下：

·系统门的数目达到了5000，Logic cell数目达到了238，系统资源丰富；

·具备片上可编程分布式RAM，最多可编程的RAM达3200bit；

·分布式算术逻辑单元，支持分布式DSP运算；

·灵活的高速时钟网络，内部三态总线；工作电压为3.3V。

有关XCS05XL的详细资料请参阅参考文献[1]。

FPGA的编程数据存储在单片机的FLASH ROM里。每次上电后单片机将编程数据装入XCS05XL，编程模式选从串模式，因而其22脚（M1）和24脚（M0）悬空。编程数据装入后，XCS05XL的逻辑功能就确定了；XCS05XL控制视频信号的输入及A/D转换，在其内部将每路视频信号压缩为原来的1/2，同时在单片机的控制下给每路叠加时间、日期、通道数字字符信息，然后将压缩的四路视频信号合成为

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